Argomenti trattati il 16/11/2006
Flip-Flop D (delay): definizione, tabella di veritą. Flip-Flop JK: definizione, tabella di veritą. Flip-Flop T (toggle): definizione, tabella di veritą.
Tabelle di veritą per ricavare le funzioni di eccitazione di tutti i tipi di Flip-Flop.
Analisi di reti sequenziali sincrone: procedimento.
Analisi di reti sequenziali sincrone: esempio di analisi di un circuito sequenziale contatore secondo lo schema di procedimento (costruzione della tabella degli stati futuri; diagramma di stato (automa) di una rete sequenziale e di una macchina sequenziale; descrizione verbale).
-- AnnalisaMassini - 16 Nov 2006
Edit | Attach | Topic revision: r1 - 2006-11-16 - AnnalisaMassini
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